 芯片設(shè)計、實現(xiàn)與FPGA驗證 |
| 培養(yǎng)目標 |
| 通過培訓(xùn)使學(xué)員專項技能水平達到相當于中級技術(shù)等級；掌握集成電路基本工藝設(shè)計知識、版圖設(shè)計基礎(chǔ)知識，了解半導(dǎo)體基礎(chǔ)理論，能熟練使用EDA軟件軟件進行基本版圖設(shè)計。 |
| 培養(yǎng)對象 |
1.理工科背景，有志于數(shù)字集成電路設(shè)計工作的學(xué)生和轉(zhuǎn)行人員；
2.需要充電，提升技術(shù)水平和熟悉設(shè)計流程的在職人員；
3.集成電路設(shè)計企業(yè)的員工內(nèi)訓(xùn)。
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| .入.學(xué).要.求. |
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學(xué)員學(xué)習本課程應(yīng)具備下列基礎(chǔ)知識：
◆電路系統(tǒng)的基本概念。 |
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.班.級.規(guī).模.及.環(huán).境 |
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堅持小班授課，為保證培訓(xùn)效果，增加互動環(huán)節(jié)，每期人數(shù)限3到5人。 |
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.上.課.時.間.和.地.點. |
上課地點：【上�！浚和瑵髮W(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山學(xué)院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
近開課時間(周末班/連續(xù)班/晚班）： 芯片實現(xiàn)開班時間：即將開課，詳情請咨詢客服。..(歡迎您垂詢，視教育質(zhì)量為生命！) |
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實驗設(shè)備 |
☆資深工程師授課
☆注重質(zhì)量
☆邊講邊練
☆合格學(xué)員免費推薦工作
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新 優(yōu) 惠 措 施 |
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◆在讀學(xué)生憑學(xué)生證，可優(yōu)惠500元。 |
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.質(zhì).量.保.障. |
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1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
2、培訓(xùn)結(jié)束后免費提供半年的技術(shù)支持，充分保證培訓(xùn)后出效果；
3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。 |
芯片設(shè)計、實現(xiàn)與FPGA驗證 |
第一階段 芯片實現(xiàn)
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Link-To-Layout邏輯綜合；
靜態(tài)時序分析（STA）；
時序驅(qū)動的自動布局布線；
邏輯綜合（Logic Synthesis）；
可測性設(shè)計（DFT）。
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物理綜合；
靜態(tài)時序分析（STA）；
芯片規(guī)劃（Planning）；
時序驅(qū)動的布局布線；
可測性設(shè)計（DFT）；
低功耗設(shè)計。
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物理綜合；
靜態(tài)時序分析（STA）Sign off；
RTL-to-GDS流程；
可測性設(shè)計（DFT）；
低功耗設(shè)計；
IP嵌入設(shè)計。
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第二階段 芯片測試、FPGA設(shè)計與驗證
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芯片測試基礎(chǔ)；
芯片制造工藝；
芯片測試知識；
芯片測試項目和常用輔助工具；
項目設(shè)計實踐（C）。
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數(shù)字電路邏輯設(shè)計；
CMOS集成電路設(shè)計原理；
硬件描述語言HDL及FPGA設(shè)計方法；
FPGA現(xiàn)場集成；
項目設(shè)計實踐（C）。
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總部李老師
